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基于FPGA的移動通信中卷積碼編碼器設計

作者: 時間:2012-06-18 來源:網(wǎng)絡 收藏

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3 卷積碼仿真
3.1 功能仿真
仿真前設置輸入信息序列Convolutionbit-in=“1101001001”,對應時鐘為400 ns。圖3為(2,1,9)卷積碼,碼發(fā)生器函數(shù)是:g0=(111101011),g1=(101110001)的理論編碼結果。卷積VHDL功能仿真波形如圖4所示。

本文引用地址:http://www.ljygm.com/article/154639.htm

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比較卷積碼的理論結果(見圖3)和功能仿真圖(見圖4),仿真結果與理論計算完全一致。



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