各種 IP Core和參考設(shè)計(jì)

作者：時(shí)間：2013-12-23 來源：網(wǎng)絡(luò)

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rDark=#ffffff>1024點(diǎn)FFT快速傅立葉變換，16位數(shù)據(jù)輸入/輸出，帶DMA功能，xilinx提供

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VHDL代碼

對(duì)數(shù)可以計(jì)算以2，10，e為底的對(duì)數(shù)，將license添加到原有的MaxplusII或QuartusII的license中就可以直接使用，但源代碼加密。 altera提供

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對(duì)數(shù) IP

平方根硬件求解平方根的IP 將license添加到原有的MaxplusII或QuartusII的license中就可以直接使用，但源代碼加密。 altera提供

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平方根 IP

基本數(shù)學(xué)運(yùn)算庫包括各種用VHDL語言描述的基本數(shù)學(xué)運(yùn)算單元，瑞典聯(lián)邦技術(shù)研究院（ETH）提供

使用說明

VHDL數(shù)學(xué)運(yùn)算庫1.0

信號(hào)糾錯(cuò)


CRC校驗(yàn)代碼自動(dòng)生成工具	根據(jù)輸入條件自動(dòng)產(chǎn)生各種CRC的VHDL或verilog源程序	使用手冊(cè)	在線運(yùn)行
CRC校驗(yàn)參考設(shè)計(jì)	IEEE 802.3 Cyclic Redundancy Check參考設(shè)計(jì)，xilinx提供	使用手冊(cè)	Verilog代碼
CRC校驗(yàn)參考設(shè)計(jì)	可配置CRC參考設(shè)計(jì) xilinx提供	使用手冊(cè)	VHDL代碼和說明
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