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FPGA廠商謀求便攜電子江山
- ——QuickLogic公司新近推出“北極熊”方案 縱觀近幾年集成電路與應(yīng)用行業(yè)的發(fā)展?fàn)顩r，F(xiàn)PGA技術(shù)的廣泛應(yīng)用和消費(fèi)類電子產(chǎn)品的快速增長是其中奪目的亮點(diǎn)。現(xiàn)在，這兩者之間開始出現(xiàn)相互融合的趨勢——FPGA一改平日價格高不可攀的傲慢，相繼推出了多款低價產(chǎn)品，再加上其天生的靈活
- 關(guān)鍵字： FPGA 單片機(jī) 工業(yè)控制 嵌入式系統(tǒng) 工業(yè)控制
利用APTIX MP3C和Spartan-IIE FPGA實(shí)現(xiàn)數(shù)據(jù)系統(tǒng)的
- 隨著數(shù)字電路設(shè)計的規(guī)模及復(fù)雜程度的提高，對其進(jìn)行測試試驗(yàn)證所花費(fèi)的時間和費(fèi)用也隨之提高，所以減少測試驗(yàn)證成本是當(dāng)前數(shù)字電路設(shè)計的關(guān)鍵。
- 關(guān)鍵字： Spartan-IIE APTIX MP3C FPGA
基于FPGA的高級數(shù)據(jù)加密AES中的字節(jié)替換設(shè)計
- 介紹AES中的字節(jié)替換算法原理并闡述基于FPGA的設(shè)計和實(shí)現(xiàn)。為了提高系統(tǒng)工作速度，在設(shè)計中應(yīng)用了流水線技術(shù)。
- 關(guān)鍵字： FPGA AES 數(shù)據(jù)加密 字節(jié)
BittWare用FPGA實(shí)現(xiàn)I/O開關(guān)量大于5Gbps
- BittWare是混合(DSP和FPGA)電路板級方案供應(yīng)商，日前該公司采用ADI的TigerSHARC及Altera的FPGA技術(shù)，推出ATLANTiS Rev 2.0(新TigerSHARC使用的高級傳輸鏈路架構(gòu))、I/O切換和處理器件。 ATLANTiS采用FPGA實(shí)現(xiàn)，便于板外I/O通訊路由和處理，允許系統(tǒng)設(shè)計師們設(shè)置并動態(tài)連接。所有輸入和輸出均通過ATLANTiS進(jìn)行路由，每簇通信量大于5GBps。ATLANTiS集成了DSP、PCI橋、PMC接口和I/O外設(shè)及板載F
- 關(guān)鍵字： 5Gbps BittWare FPGA I/O
用FPGA控制CLC5958型A/D轉(zhuǎn)換器實(shí)現(xiàn)的高速PCI數(shù)據(jù)采集卡
- 詳細(xì)介紹CLC5958的內(nèi)部結(jié)構(gòu)和基本用法，提出一種基于FPGA和PCI總線的高速數(shù)據(jù)采集卡設(shè)計方案，并通過仿真驗(yàn)證了該方案的可行性。
- 關(guān)鍵字： 高速 PCI 數(shù)據(jù)采集 實(shí)現(xiàn) 轉(zhuǎn)換器 控制 CLC5958 A/D FPGA
采用FPGA的低功耗系統(tǒng)設(shè)計
- 結(jié)合采用低功耗元件和低功耗設(shè)計技術(shù)在目前比以往任何時候都更有價值。隨著元件集成更多功能，并越來越小型化，對低功耗的要求持續(xù)增長。當(dāng)把可編程邏輯器件用于低功耗應(yīng)用時，限制設(shè)計的低功耗非常重要。本文將討論減小動態(tài)和靜態(tài)功耗的各種方法，并且給出一些例子說明如何使功耗最小化。 功耗的三個主要來源是啟動、待機(jī)和動態(tài)功耗。器件上電時產(chǎn)生的相關(guān)電流即是啟動電流；待機(jī)功耗又稱作靜態(tài)功耗，是電源開啟但I(xiàn)/O上沒有開關(guān)活動時器件的功耗；動態(tài)功耗是指器件正常工作時的功耗。 啟動電流因器件而異
- 關(guān)鍵字： FPGA 嵌入式 消費(fèi)電子
基于Nios II的自動指紋識別系統(tǒng)設(shè)計
- 介紹基于Nios II處理器的嵌入式自動指紋識別系統(tǒng)的實(shí)現(xiàn)方法；具體說明自動指紋識別系統(tǒng)的基本原理、系統(tǒng)總體結(jié)構(gòu)、硬件結(jié)構(gòu)設(shè)計、用戶自定義指令的設(shè)計
- 關(guān)鍵字： Nios 自動 指紋識別 系統(tǒng)設(shè)計
基于FPGA的毫米波多目標(biāo)信號形成技術(shù)的研究
- 毫米波多目標(biāo)信號發(fā)生器通過模擬的方法產(chǎn)生多種類型高精度的雷達(dá)多目標(biāo)回波信號，在實(shí)際雷達(dá)系統(tǒng)前端不具備的條件下對雷達(dá)系統(tǒng)后級進(jìn)行調(diào)試，便于制導(dǎo)武器的性能測試，大大加快新武器的研制進(jìn)程。毫米波多目標(biāo)信號產(chǎn)生的關(guān)鍵是要求回波信號距離分辨率極高，常規(guī)的多目標(biāo)信號產(chǎn)生方法如使用數(shù)字延時線產(chǎn)生多目標(biāo)之間的延時，其控制不靈活，并且有些延時線需要接ECL電源，使用不方便也增加了設(shè)計的復(fù)雜度。使用分立元件實(shí)現(xiàn)延時則使電路元件過多，電路的穩(wěn)定性及延時的精確性也會大大降低。本文介紹一種新的產(chǎn)生毫米波雷達(dá)模擬器的多目標(biāo)信號的方法
- 關(guān)鍵字： FPGA
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