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正交相干檢波方法及FPGA的實(shí)現(xiàn)

  • 正交相干檢波方法及FPGA的實(shí)現(xiàn),引言
    現(xiàn)代雷達(dá)普遍采用相參信號(hào)來(lái)進(jìn)行處理,而如何獲得高精度基帶數(shù)字正交(I,Q)信號(hào)是整個(gè)系統(tǒng)信號(hào)處理成敗的關(guān)鍵。傳統(tǒng)的做法是采用模擬相位檢波器來(lái)得到I、Q信號(hào),其正交性能一般為:幅度平衡在2%左右,相位
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基于FPGA與SDRAM的數(shù)字電視信號(hào)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

  • 要FPGA與的數(shù)字信號(hào)采集系統(tǒng)??梢蕴峁┐笕萘康拇鎯?chǔ)空間。提供優(yōu)秀的系統(tǒng)適應(yīng)能力。該方案通過(guò)計(jì)算機(jī)并口實(shí)現(xiàn)與計(jì)算機(jī)的通信 ,但是高性能的邏輯分析儀
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扎克伯格的AI芯:高調(diào)挖角,瘋狂招人

  •   據(jù)悉國(guó)內(nèi)正在熱議“缺芯”的時(shí)候,F(xiàn)acebook傳出正在招人,計(jì)劃自己研發(fā)AI芯片。  目前,F(xiàn)acebook的AI芯片團(tuán)隊(duì)還處在早期的起步組建階段。就在最近,F(xiàn)acebook才剛剛從谷歌挖來(lái)一員大將——谷歌前芯片產(chǎn)品開發(fā)部門負(fù)責(zé)人Shahriar Rabii跳槽,擔(dān)任Facebook副總監(jiān)及芯片部分負(fù)責(zé)人一職。  而更早之前的4月19日,F(xiàn)acebook的第一條AI芯片招聘信息開始在線上流傳。在招聘信息當(dāng)中,F(xiàn)acebook宣布即將為招聘一名管理者(Manger)來(lái)組建“端對(duì)端SoC/ASIC固件和
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基于DSP+FPGA+ASIC的實(shí)時(shí)圖像處理架構(gòu)設(shè)計(jì)

  •   1.引言  隨著紅外焦平面陣列技術(shù)的快速發(fā)展,紅外成像系統(tǒng)實(shí)現(xiàn)了高幀頻、高分辨率、高可靠性及微型化,在目標(biāo)跟蹤、智能交通監(jiān)控中得到了越來(lái)越多的應(yīng)用,并向更加廣泛的軍事及民用領(lǐng)域擴(kuò)展。實(shí)時(shí)紅外圖像處理系統(tǒng)一般會(huì)包括非均勻校正、圖像增強(qiáng)、圖像分割、區(qū)域特征提取、目標(biāo)檢測(cè)及跟蹤等不同層次的實(shí)時(shí)圖像處理算法,由于圖像處理的數(shù)據(jù)量大,數(shù)據(jù)處理相關(guān)性高,因此實(shí)時(shí)紅外圖像處理系統(tǒng)必須具有強(qiáng)大的運(yùn)算能力。目前有些紅外圖像處理系統(tǒng)使用FPGA實(shí)現(xiàn)可重構(gòu)計(jì)算系統(tǒng)[1],運(yùn)算速度快,但對(duì)于復(fù)雜算法的實(shí)現(xiàn)難度比較高,且靈活性
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單片機(jī)學(xué)習(xí)的四個(gè)階段 

  •   第一階段  是先瀏覽教科書里的硬件部分,大至了解單片機(jī)的硬件結(jié)構(gòu)。如ROM、RAM、地址、I/O口等,以及看一些廠家的MCU資料(Data Sheet),來(lái)加強(qiáng)MCU所提供各項(xiàng)資源的印象。  第二階段  就是了解二進(jìn)位數(shù)字、十六進(jìn)位數(shù)和軟件方面的內(nèi)容。盡管有很多高級(jí)語(yǔ)言可用于單片機(jī)的編程,但我覺得初學(xué)還是以匯編語(yǔ)言為好,更有利于和硬件結(jié)合,掌握硬件結(jié)構(gòu)。知道匯編語(yǔ)言、機(jī)器語(yǔ)言、 指令、 程序等概念后,就從MOV指令開始,學(xué)習(xí)匯編語(yǔ)言和編程,在此如51的MCU匯編語(yǔ)言系統(tǒng)有  111條指令,簡(jiǎn)單又好理解
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DSP、MCU、MPU的區(qū)別在哪些地方?

  •   CPU(Central Processing Unit,中央處理器)發(fā)展出來(lái)三個(gè)分枝,一個(gè)是DSP(Digital Signal Processing/Processor,數(shù)字信號(hào)處理),另外兩個(gè)是MCU(Micro Control Unit,微控制器單元)和MPU(Micro Processor Unit,微處理器單元)?! CU集成了片上外圍器件;MPU不帶外圍器件(例如存儲(chǔ)器陣列),是高度集成的通用結(jié)構(gòu)的處理器,是去除了集成外設(shè)的MCU;DSP運(yùn)算能力強(qiáng),擅長(zhǎng)很多的重復(fù)數(shù)據(jù)運(yùn)算,而MCU則適合
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殘喘多年國(guó)產(chǎn)FPGA廠商迎來(lái)新機(jī)遇

  • 作為通信設(shè)備核心器件的FPGA產(chǎn)品,國(guó)內(nèi)企業(yè)也攻關(guān)多年,現(xiàn)狀又如何?
  • 關(guān)鍵字: FPGA  芯片  

徹底擺脫智能手表續(xù)航差的魔咒

  • 可穿戴設(shè)備的熱度居高不下,前有Moto Actv這樣的先驅(qū),后又在眾籌平臺(tái)大熱的Pebble,眾多廠商隨后也相繼推出了自家的智能手表產(chǎn)品,有三星這樣的國(guó)際
  • 關(guān)鍵字: 智能手表  低功耗技術(shù)  MCU  電池續(xù)航  

新勢(shì)能帶動(dòng)MCU發(fā)展 40nm漸成主流

  •   隨著人工智能、自動(dòng)駕駛的到來(lái),MCU再次成為焦點(diǎn)。面對(duì)應(yīng)用領(lǐng)域的技術(shù)變革,MCU領(lǐng)域的市場(chǎng)空間被新勢(shì)能帶動(dòng)。MCU的市場(chǎng)與技術(shù)走勢(shì)也發(fā)生了改變,MCU展現(xiàn)出的新特征讓很多廠商捕捉到了商機(jī)。在這一波風(fēng)口中,企業(yè)都有哪些機(jī)遇?MCU制造工藝的發(fā)展趨勢(shì)如何?中國(guó)市場(chǎng)在其中扮演著什么樣的角色?《中國(guó)電子報(bào)》邀請(qǐng)主流企業(yè)嘉賓,共話MCU新氣象和新未來(lái)?!⌒乱淮畔⒓夹g(shù)產(chǎn)業(yè)帶動(dòng)MCU需求擴(kuò)張  記者:對(duì)于2018年MCU市場(chǎng)需求狀況各位怎樣看待?MCU的價(jià)格走勢(shì)是否會(huì)發(fā)生較大變化?  Alex Koepsel:根
  • 關(guān)鍵字: MCU  40nm  

基于MSP430FR 系列MCU 的多功能雙接口存儲(chǔ)器設(shè)計(jì)

  • 摘要在許多嵌入式系統(tǒng)中通常會(huì)需要外接存儲(chǔ)器保存數(shù)據(jù),例如EEPROM。由于傳統(tǒng)的存儲(chǔ)器具有功能單一、接口固定、擦寫次數(shù)有限的特點(diǎn)從而限制了存儲(chǔ)器的
  • 關(guān)鍵字: MSP430FR  MCU  雙接口  存儲(chǔ)器設(shè)計(jì)  

方案簡(jiǎn)介:基于CDMA技術(shù)的水聲通訊系統(tǒng)

  • 任何信息需要借助聲、光、電信 號(hào)進(jìn)行傳遞,由于光信號(hào)和電信號(hào)在海水中的衰減比較嚴(yán)重,而聲波是人類迄今為止已知的惟一能在水中遠(yuǎn)距離傳播的能量形
  • 關(guān)鍵字: 水聲通信  CDMA  BPSK  FPGA  

ASIC大爆發(fā)之際,F(xiàn)PGA怎么辦?

  • AI芯片不會(huì)是一兩顆芯片打遍天下,整體而言,F(xiàn)PGA、GPU、ASIC三大主要AI芯片將在很長(zhǎng)一段時(shí)間內(nèi)同時(shí)存在。
  • 關(guān)鍵字: ASIC  FPGA  

fpga應(yīng)用的實(shí)用電路原理圖

  • fpga應(yīng)用的實(shí)用電路原理圖, FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不
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汽車識(shí)別系統(tǒng)的經(jīng)典設(shè)計(jì)方案匯總,包括原理圖,源代碼

  • 車牌識(shí)別技術(shù)是計(jì)算機(jī)視頻圖像識(shí)別技術(shù)在車輛牌照識(shí)別中的一種應(yīng)用。車牌識(shí)別技術(shù)要求能夠?qū)⑦\(yùn)動(dòng)中的汽車牌照從復(fù)雜背景中提取并識(shí)別出來(lái),通過(guò)車牌提
  • 關(guān)鍵字: 車牌識(shí)別  matlab  FPGA  DSP  CPLD  

基于FPGA的高精度同步時(shí)鐘系統(tǒng)設(shè)計(jì)

  • 摘要: 介紹了精密時(shí)鐘同步協(xié)議(PTP)的原理。本文精簡(jiǎn)了該協(xié)議,設(shè)計(jì)并實(shí)現(xiàn)了一種低成本、高精度的時(shí)鐘同步系統(tǒng)方案。該方案中,本地時(shí)鐘單元、時(shí)鐘協(xié)議
  • 關(guān)鍵字: 測(cè)試  FPGA  
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